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電源完整性測(cè)試,電源輸出穩(wěn)定測(cè)試

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SI/PI是涉及數(shù)字電路正確操作的相關(guān)的兩種分析。SI重點(diǎn)確保傳輸?shù)?在接收器端還是1(對(duì)0同樣如此),對(duì)SI分析目標(biāo)是消除關(guān)于信號(hào)質(zhì)量、串?dāng)_和定時(shí)的問題;

信號(hào)質(zhì)量

獲取具有明確的邊緣,且沒有過度過沖和下沖的信號(hào)。通??梢酝ㄟ^添加某種類型的端接以使驅(qū)動(dòng)器的阻抗和傳輸線的阻抗相匹配來解決這些問題。對(duì)于多點(diǎn)分支總線,需要將端接和拓?fù)涞拈L度變化相結(jié)合來控制反射。

串?dāng)_

涉及多條相互耦合的傳輸線,隨著走線擠進(jìn)密集的電路板設(shè)計(jì),了解它們正在相互耦合多少能量對(duì)于消除因串?dāng)_產(chǎn)生的錯(cuò)誤是非常重要的。

分析模型包括驅(qū)動(dòng)器和接收器、芯片封裝及電路板互連(由走線及過孔、分立器件和/或連接器組成的模型)。

驅(qū)動(dòng)器和接收器模型

包括緩沖器阻抗、翻轉(zhuǎn)率和電壓擺幅信息,通常IBIS或SPICE模型用作緩沖器模型

互連模型

包括行為類似與傳輸線的電路板走線。此類傳輸線具有阻抗、延遲和損耗特性,決定了所連接的驅(qū)動(dòng)器和接收器與彼此進(jìn)行交互的方式。

基本的信號(hào)完整性分析包括設(shè)置電路板疊層(包括適當(dāng)?shù)慕殡妼雍穸龋?,以及查找正確的走線寬度,實(shí)現(xiàn)一定的走線目標(biāo)阻抗。

 

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